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你可能喜欢数字电路有三种状态_解决方案网当前位置:& &&&请问关于ARM_GPIO上拉电阻有关问题请问关于ARM_GPIO上拉电阻有关问题本文收集于网络，只用于方便查找方案，感谢源作者，如果侵权请联系删除请教关于ARM_GPIO上拉电阻问题请教各位GPIO的上拉电阻的作用除了驱动能力会增强外当设置GPIO为输入状态时，产品做高温实验，温度升高造成了GPIO检测的输入状态不对，是否是上拉电阻的原因？？？------解决方案--------------------上拉电阻和下拉电阻 上拉电阻：1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。2、OC门电路必须加上拉电阻，才能使用。3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。3、对于高速电路，过大的上拉电阻可能边沿变平缓。综合考虑以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理& 对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：1． 驱动能力与功耗的平衡。以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。2． 下级电路的驱动需求。同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。3． 高低电平的设定。不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。4． 频率特性。以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟，电阻越大，延迟越大。上拉电阻的设定应考虑电路在这方面的需求。下拉电阻的设定的原则和上拉电阻是一样的。OC门输出高电平时是一个高阻态，其上拉电流要由上拉电阻来提供，设输入端每端口不大于100uA,设输出口驱动电流约500uA，标准工作电压是5V，输入口的高低电平门限为0.8V(低于此值为低电平)；2V(高电平门限值)。选上拉电阻时：500uA x 8.4K= 4.2即选大于8.4K时输出端能下拉至0.8V以下，此为最小阻值，再小就拉不下来了。如果输出口驱动电流较大，则阻值可减小，保证下拉时能低于0.8V即可。当输出高电平时，忽略管子的漏电流，两输入口需200uA200uA x15K=3V即上拉电阻压降为3V，输出口可达到2V，此阻值为最大阻值，再大就拉不到2V了。选10K可用。COMS门的可参考74HC系列设计时管子的漏电流不可忽略，IO口实际电流在不同电平下也是不同的，上述仅仅是原理，一句话概括为：输出高电平时要喂饱后面的输入口，输出低电平不要把输出口喂撑了（否则多余的电流喂给了级联的输入口，高于低电平门限值就不可靠& 网友评论：1,一般来说，上拉就是接到高电平，下来就是接到低电平.2,主要是为了提高芯片引脚的驱动能力或者是为了防止临界电平会引起错误的操作!例如,有的芯片引脚驱动能力较差,不能将电平拉高,就必须接上拉电阻;对于中断引脚也必须接上拉(对于低电平有效)或下拉(对于高电平有效)防止误中断3,上拉就是通过一个电阻接到高电平；下拉就是通过一个电阻接到参考地（低电平）。 &在数字电路中不用的输入脚都要接固定电平，通过1k电阻接高电平或接地。& 1. 电阻作用：& l 接电组就是为了防止输入端悬空& l 减弱外部电流对芯片产生的干扰& l 保护cmos内的保护二极管,一般电流不大于10mA& l 上拉和下拉、限流& l 1. 改变电平的电位，常用在TTL-CMOS匹配& 2. 在引脚悬空时有确定的状态& 3.增加高电平输出时的驱动能力。& 4、为OC门提供电流& l 那要看输出口驱动的是什么器件，如果该器件需要高电压的话，而输出口的输出电压又不够，就需要加上拉电阻。& l 如果有上拉电阻那它的端口在默认值为高电平你要控制它必须用低电平才能控制如三态门电路三极管的集电极，或二极管正极去控制把上拉电阻的电流拉下来成为低电平。反之，& l 尤其用在接口电路中,为了得到确定的电平,一般采用这种方法,以保证正确的电路状态,以免发生意外,比如,在电机控制中,逆变桥上下桥臂不能直通,如果它们都用同一个单片机来驱动,必须设置初始状态.防止直通!& 2、定义：& l 上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！& l 上拉是对器件注入电流，下拉是输出电流& l 弱强只是上拉电阻的阻值不同，没有什么严格区分& l 对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。& 3、为什么要使用拉电阻：& l 一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。& l 数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！& l 一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似与一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平，C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗：& 比如：当一个接有上拉电阻的端口设为输如状态时，他的常态就为高电平，用于检测低电平的输入。& l 上拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流，下拉电阻是用来吸收电流的，也就是你同学说的灌电流
------解决方案--------------------靓仔，你的头像太恐怖了，很吓人啊。哈哈。要向我学习，走青春聪慧美女头像路线。
------解决方案--------------------当然了，，你的东西不像是上拉电阻问题。我的回答是给你个提醒。我没有遇到你的问题啊。到时候解决记得告诉俺----------这个板块比较冷清，我准备带一些小弟来撑场面。哈哈
------解决方案--------------------你不加上拉会有问题吗？我觉得跟上拉没关系，应该是其他部分异常。 上一篇：下一篇：
File: 13:19:48单片机弱上拉输出和推挽输出的区别是什么？_百度知道
单片机弱上拉输出和推挽输出的区别是什么？
推挽输出:可以输出高,低电平,连接数字器件; 开漏输出:输出端相当于三极管的集电极. 要得到高电平状态需要上拉电阻才行. 适合于做电流型的驱动,其吸收电流的能力相对强(一般20ma以内).
推挽结构一般是指两个三极管分别受两互补信号的控制,总是在一个三极管导通的时候另一个截止.
要实现 线与 需要用OC(open collector)门电路.是两个参数相同的三极管或MOSFET,以推挽方式存在于电路中,各负责正负半周的波形放大任务,电路工作时，两只对称的功率开关管每次只有一个导通，所以导通损耗小,效率高。输出既可以向负载灌电流，也可以从负载抽取电流。开漏电路特点及应用
在电路设计时我们常常遇到开漏（open drain）和开集（open collector）的概念。　所谓开漏电路概念中提到的“漏”就是指MOSFET的漏极。同理，开集电路的“集”就是指三极管的集电极。开漏电路就是指以MOSFET的漏极为输出的电路。一般的用法是会在漏极外部的电路添加上拉电阻。完整的开漏电路应该由开漏器件和开漏上拉电阻组成。
组成开漏形式的电路有以下几个特点：1. 利用外部电路的驱动能力，减少IC内部的驱动。当IC内部MOSFET导通时，驱动电流是从外部的VCC流经R pull-up ，MOSFET到GND。IC内部仅需很下的栅极驱动电流。如图1。2. 可以将多个开漏输出的Pin，连接到一条线上。形成 “与逻辑” 关系。当PIN_A、PIN_B、PIN_C任意一个变低后，开漏线上的逻辑就为0了。这也是I2C，SMBus等总线判断总线占用状态的原理。3. 可以利用改变上拉电源的电压，改变传输电平。 IC的逻辑电平由电源Vcc1决定，而输出高电平则由Vcc2决定。这样我们就可以用低电平逻辑控制输出高电平逻辑了。4. 开漏Pin不连接外部的上拉电阻，则只能输出低电平(因此对于经典的51单片机的P0口而言，要想做输入输出功能必须加外部上拉电阻，否则无法输出高电平逻辑)。5. 标准的开漏脚一般只有输出的能力。添加其它的判断电路，才能具备双向输入、输出的能力。应用中需注意：1.
开漏和开集的原理类似，在许多应用中我们利用开集电路代替开漏电路。例如，某输入Pin要求由开漏电路驱动。则我们常见的驱动方式是利用一个三极管组成开集电路来驱动它，即方便又节省成本。2. 上拉电阻R pull-up的 阻值 决定了 逻辑电平转换的沿的速度 。阻值越大，速度越低功耗越小。反之亦然。
Push-Pull输出就是一般所说的推挽输出，在CMOS电路里面应该较CMOS输出更合适，应为在CMOS里面的push－pull输出能力不可能做得双极那么大。输出能力看IC内部输出极N管P管的面积。和开漏输出相比，push－pull的高低电平由IC的电源低定，不能简单的做逻辑操作等。push－pull是现在CMOS电路里面用得最多的输出级设计方式。51单片机的I/O口是开漏输出，驱动能力较弱，所以一般都要加上拉电阻去驱动下一级电路，而AVR，STM8S系列的都是真正的双向I/O口，推挽输出，电流可达20mA左右。
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jpg" target="_blank" title="点击查看大图" class="ikqb_img_alink"><img class="ikqb_img" src="/zhidao/wh%3D600%2C800/sign=33a4ccf3a0a246fd3a76de27/eac4bc0a4b90eb88://d；而推挽输出是用两个晶体管或者场效应管构成的推挽电路（在模拟电路中应用很广泛如功放驱动电机驱动等等），所以能够驱动大的负载://d，或者查阅相关的书籍.hiphotos！<a href="http，弱上拉输出阻抗大.com/zhidao/pic/item/eac4bc0a4b90eb88，这个电路的特点就是输出电阻小.baidu这个的区别主要是驱动能力的大小://d，从而能够使得单片机管脚直接驱动发光二极管.baidu，导致内阻分压太大从而不能驱动大的负载.com/zhidao/wh%3D450%2C600/sign=d83d5613f21fbe091c0bcb105e502005/eac4bc0a4b90eb88.baidu.hiphotos，也就是输出阻抗！具体的电路可以参考下面的图片、甚至更小阻抗的负载.jpg" esrc="http，当有大的负载时相当于一个电池的内阻很大.hiphotos、蜂鸣器
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对负载而言,低电平，共同完成电流输出任务，前者是分时输出,连接数字器件,总是在一个三极管导通的时候另一个截止上拉在单片机的管脚经常用:可以输出高，一个“臂”的电流增加时；推挽结构一般是指两个三极管分别受两互补信号的控制，另一个“臂”的电流则减小。
这两种方式主要就是输出的形式不一样，一个“臂”在拉，二者的状态轮流转换，好象是一个“臂”在推推挽放大器的输出级有两个“臂”（两组放大元件），提高输出能力和驱动能力。推挽输出
推挽输出:可以输出高,低电平,连接数字器件；推挽结构一般是指两个三极管分别受两互补信号的控制,总是在一个三极管导通的时候另一个截止
开漏输出:输出端相当于三极管的集电极. 要得到高电平状态需要上拉电阻才行. 适合于做电流型的驱动,其吸收电流的能力相对强(一般20ma以内).
上拉电阻：
1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需 要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2、OC（集电极开路）门电路必须加上拉电阻，才能使用。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通 路。
能承受的电流不一样，推挽输出电流电流较大
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出门在外也不愁单片机的IO口输入输出是相对什么讲的_百度知道
单片机的IO口输入输出是相对什么讲的
但是他IO口的值不是还受IO口上连接的东西的影响吗，这个东西就是1或0吧，那么是不是IO上接的东西不一样给IO口在输出为高或低状态的数值也是不一样的还有输入又是怎么一回事？输出1的话，就是把IO口的电压弄大到一定值，输出为0就是把IO口的电压值降到一定小的值是这样的吗输出是从IO口往外输出东西吗
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如果为5V，就是单片机通过软件置位相关寄存器让端口置高电平或低电平，达到电平输出的目的;O口只能出入或者输出0和1，I/O口即通用输出输出口;O的结构，就是单片机捕捉端口的电平然后置位相关寄存器。这是很通俗的理解，如果想更深的了解可以参考通用I&#47，高电平就为3，低电平为0V，1对应高电平.3V系统，0对应低电平，那高电平就为5V，达到输入作用，如果是3，如果做输入口，然后软件读取寄存器中0或1.3。如果做输出口的话I&#47
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片机的 IO 口 (输入/ VCC/输出 口）;2
有些差异，就是 单片机 IO 口 往外输出 信号
1 或者 0 （ 1 的输出电圧 = VCC ， 0 的电圧 = 0 V ）或者 单片机从
IO 口 读取 输入 信息 1 或者 0 （ 可以 理解为 1 &gt， 0 为 低电平;2
，对于 不同 型号 的 单片机 这个
& VCC/2 )也就是
1 为 高电平 ，是相对单片机 本身 而言的
感觉应该这样理解：
*1*I/O口的输出是对电流而言的，高电平输出就是输出（或拉出）电流，低电平输出就是输入（或灌入）电流，一般C51单片机1状态为高电平状态，电压接近于电源电压（5V），0状态为低电平状态接近0伏；我们在应用其输出功能时，首先就要在设计上保证I/O口输出高电平时电压不能降低，因其拉电流能力及其微弱，所以高电平输出时一般只用于MOS元件或TTL接口的控制，另外，I/O口的低电平输出时，要保证灌入的电流不超过芯片的要求，否则也不能正常工作；
*2*I/O口的输入是对电压而言的，一般当口上电压高于2V时，单片机会作为高电平采如，低于0.8V是单片机会认为是低电平，至于高低电平的电压究竟时多少，各系列芯片或有差异。
*3*至于“那么是不是IO上接的东西不一样给IO口在输出为高或低状态的数...
IO口，I是input 输入O是out 输出 输出是，设定这个脚为输出，读取这个脚的状态值的话，1为高电压，0为低电平。输出一般是驱动一个小东西，再带动一个大装置来达到自己想要的要求。输出你可以看做一个电源。能给你的东西供电。就象电源不会随你会接的东西影响，它始终都是电源。只是有状态，有电，没电。。负载太大的话，只能说是驱动不起来。它输出的状态没变。设计时肯定要避免负载过大的。 输入就像是接受端。你给我电，单片机就会知道，输入端是1，你不给我电，输入端是0。一般大于1.2V，单片机就能识别为1。
输入输出的相关知识
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出门在外也不愁关于各种IO输出的类型，强烈推荐新手收藏！！
> 关于各种IO输出的类型，强烈推荐新手收藏！！
关于各种IO输出的类型，强烈推荐新手收藏！！
　　文章内容为关于各种的类型，希望对大家有用。本文引用地址：
　　集电极开路、漏极开路、推挽、上拉电阻、弱上拉、三态门、准双向口
　　集电极开路输出的结构如图1所示，右边的那个三极管集电极什么都不接，所以叫做集电极开路;左边的三极管为反相之用，使输入为&0&时，输出也为&0&。
　　对于图 1，当左端的输入为&0&时，前面的三极管截止，所以5v电源通过1k电阻加到右边的三极管上，右边的三极管导通;当左端的输入为&1&时，前面的三极管导通，而后面的三极管截止。
　　我们将图1简化成图2的样子，很明显可以看出，当开关闭合时，输出直接接地，所以输出电平为0。而当开关断开时，则输出端悬空了，即高阻态。这时电平状态未知，如果后面一个电阻负载到地，那么输出端 的电平就被这个负载拉到低电平了，所以这个电路是不能输出高电平的。
　　图3中那个1k的电阻即是上拉电阻。如果开关闭合，则有电流从1k电阻及开关上流过，但由于开关闭和时电阻为0(方便我们的讨论，实际情况中开关电阻不为0，另外对于三极管还存在饱和压降)，所以在开关上的电压为0，即输出电平为0。如果开关断开，则由于开关电阻为无穷大(同上，不考虑实际中的 漏电流)，所以流过的电流为0，因此在1k 电阻上的压降也为0，所以输出端的电压就是5v了，这样就能输出高电平了。
　　但是这个输出的内阻是比较大的&&即1k，如果接一个电阻为r的负载，通过分压计算，就可以算得最后的输出电压为5*r/(r+1000)伏，所以，如果要达到一定的电压的话，r就不能太小。如果r 真的太小，而导致输出电压不够的话，那我们只有通过减小那个1k的上拉电阻来增加驱动能力。但是，上拉电阻又不能取得太小，因为当开关闭合时，将产生电流，由于开关能流过的电流是有限的，因此限制了上拉电阻的取值。另外还需要考虑到，当输出低电平时，负载可能还会给提供一部分电流从开关流过，因此要综合这些电流考虑来选择合适的上拉电阻。
　　如果我们将一个读数据用的输入端接在输出端，这样就是一个IO口了，51的IO口就是这样的结构，其中P0口内部不带上拉，而其它三个口带内部上拉。当我们要使用输入功能时，只要将输出口设置为1即可，这样就相当于那个开关断开，而对于P0口来说，就是高阻态了。
　　对于漏极开路(OD)输出，跟集电极开路输出是十分类似的。将上面的三极管换成场效应管即可。这样集电极就变成了漏极，OC就变成了OD，原理分析是一样的。
　　OC门主要用于3个方面：实现与或非逻辑，用做电平转换，用做驱动器。
　　开漏形式的电路有以下几个特点：
　　1.利用外部电路的驱动能力，减少IC内部的驱动，或驱动比芯片电源电压高的负载。
　　2.可以将多个开漏输出的Pin，连接到一条线上。通过一只上拉电阻，在不增加任何器件的情况下，形成&与逻辑&关系。这也是I2C，SMBus等总线判断总线占用状态的原理。
　　3.由于漏级开路，所以后级电路必须接一上拉电阻，上拉电阻的电源电压就可以决定输出电平。这样就可以进行任意电平的转换了。
　　4.源极开路提供了灵活的输出方式，但是也有其弱点，就是带来上升沿的延时。因为上升沿是通过外接上拉无源电阻对负载充电，所以当电阻选择小时延时就小，但功耗大;反之延时大功耗小。所以如果对延时有要求，则建议用下降沿输出。
　　另一种输出结构是推挽输出。推挽输出的结构就是把上面的上拉电阻也换成一个开关，当要输出高电平时，上面的开关通，下面的开关断;而要输出低电平时，则刚好相反。比起OC或者OD来说，这样的推挽结构高、低电平驱动能力都很强。如果两个输出不同电平的输出口接在一起的话，就会产生很大的电流，有可能将输出口烧坏。而上面说的OC或OD输出则不会有这样的情况，因为上拉电阻提供的电流比较小。如果是推挽输出的要设置为高阻态时，则两个开关必须同时断开(或者在输出口上使用一个传输门)，这样可作为输入状态，AVR单片机的一些IO 口就是这种结构。
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　　单片机内部的逻辑经过内部的逻辑运算后需要输出到外面，外面的器件可能需要较大的电流才能推动，因此在单片机的输出端口必须有一个驱动电路。这种驱动电路有两种形式：
　　其中的一种是采用一只N型三极管&&NPN或N沟道，以NPN三极管为例，就是e接地，b接内部的逻辑运算，c引出。b受内部驱动可以控制三极管是否导通，但如果三极管的c极一直悬空，尽管b极上发生高低变化，c极上也不会有高低变化，因此在这种条件下必须在外部提供一个电阻，电阻的一端接c(引出脚)另一端接电源，这样当三极管的b有高电压是三极管导通，c电压为低，当b为低电压时三极管不通，c极在电阻的拉动下为高电压。这种驱动电路有个特点：低电压是三极管驱动的，高电压是电阻驱动的&&上下不对称，三极管导通时的ec内阻很小，因此可以提供很大的电流，可以直接驱动led甚至继电器，但电阻的驱动是有限的，最大高电平输出电流=(VCC-Vh)/r;
　　另一种是互补推挽输出，采用2只晶体管，一只在上一只在下，上面的一只是n型，下面为p型(以三极管为例)，两只管子的连接为：NPN(上)的c连 VCC，PNP(下)的c接地，两只管子的ee,bb相连，其中ee作为输出(引出脚)，bb接内部逻辑。这个电路通常用于功率放大点路的末级(音响)，当bb接高电压时NPN管导通输出高电压，由于三极管的ec电阻很小，因此输出的高电压有很强的驱动能力，当bb接低电压时NPN截至，PNP导通，由于三极管的ec电阻很小因此输出的低电压有很强的驱动能力。简单的例子，9013导通时ec电阻不到10欧，以Vh=2.5v，VCC=5v计算，高电平输出电流最大=250MA，短路电流500ma，这个计算同时告诉我们采用推挽输出时一定要小心千万不要出现外部电路短路的可能，否则肯定烧毁芯片，特别是外部驱动三极管时别忘了在三极管的基极加限流电阻。推挽输出电路的形式很多，有些单片机上下都采用n型管，但内部逻辑提供互补输出，以上的说明仅仅为了说 明推挽的原理，为了更深的理解可以参考功率放大电路。
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　　上拉电阻很大，提供的驱动电流很小，叫弱上拉;反之叫强上拉。
　　为什么要使用拉电阻：
　　上拉就是将不确定的信号通过一个电阻嵌位在高电平，电阻同时起限流作用，下拉同理。上拉是对器件注入电流，下拉是输出电流，弱强只是上拉电阻的阻值不同，没有什么严格区分。
　　对于非OC、OD输出型电路提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
　　上拉电阻的主要应用：
　　1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平(一般为3.5V)，这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
　　2、OC门电路要输出&1&时需要加上拉电阻，不加根本就没有高电平。
　　3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻，但在用OC门作驱动(例如：控制一个 LED)灌电流工作时就可以不加上拉电阻。
　　4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
　　5、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。
　　6、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。
　　上拉电阻阻值的选择原则包括：
　　1、从节约功耗及芯片的灌电流能力考虑应当足够大;电阻大，电流小。
　　2、从确保足够的驱动电流考虑应当足够小;电阻小，电流大。
　　3、对于高速电路，过大的上拉电阻可能边沿变平缓。
　　综合考虑以上三点，通常在1k到10k之间选取。对下拉电阻也有类似道理。
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　　高阻态时引脚对地电阻无穷，此时读引脚电平时可以读到真实的电平值。高阻态的重要作用就是I/O(输入/输出)口在输入时读入外部电平用。
　　一般门与其它电路的连接，无非是两种状态，1或者0，在比较复杂的系统中，为了能在一条传输线上传送不同部件的信号，研制了相应的逻辑器件称为三态门。三态门，除了有这两种状态以外还有一个高阻态，就是高阻抗(电阻很大，相当于开路)。相当于该门与和它连接的电路处于断开的状态。三态门是一种扩展逻辑功能的输出级，也是一种控制开关。主要是用于总线的连接，因为总线只允许同时只有一个使用者。通常在数据总线上接有多个器件，每个器件通过OE/CE之类的信号选通。如器件没有选通的话它就处于高阻态，相当于没有接在总线上，不影响其它器件的工作。
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