实验8 AD采样控制电路设计 - 百度文库
实验8 AD采样控制电路设计
实验8 A/D采样控制电路设计
一、实验目的
1、了解一般状态机的设计方法和状态机在VHDL语言中应用。
2、学习利用状态机来实现A/D转换器ADC089的采样控制。
二、实验原理
ADC0809 为单极性、8位转换精度、逐次逼进式A/D 转换器，其采样速度为每次转换约100us。 它的各引脚功能和工作时序如图8.1 所示。有8 个模拟信号输入通道IN0~IN7, 由ADDA ADDB 和ADDC (ADDC) 为最高位作为此8 路通道选择地址,在转换开始前,由地址锁存允许信号ALE 将此3 位地址锁入锁存器中,以确定转换信号通道;EOC 为转换结束状态信号,由低电平转为高电平时指示转换结束,此时可读入转换好的8 位数据,EOC 在低电平时指示正在进行转换；START 为转换启动信号，上升沿启动；OE 为数据输出允许信号，高电平有效；CLK 为ADC 转换时钟输入端口（500kHz 左右）。为了达到A/D 器件的最高转换速度，A/D 转换控制器必须包含监测EOC 信号的逻辑，一旦EOC 从低电平变为高电平，即可将OE 置为高电平，然后传送或显示已转换好的数据[D0..D7]。
引脚图与时序图
贡献者：落落小惜4位7段数码管驱动电路设计要求_百度文库
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